13/11/2026 - La UPM reúne a especialistas en diseño abierto de chips RISC-V, aceleradores hardware y prototipado FPGA

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La arquitectura abierta RISC-V se ha convertido en un punto de interés para la investigación en diseño digital, sistemas embebidos y nuevos circuitos integrados. La Universidad Politécnica de Madrid ha organizado los días 12 y 13 de noviembre de 2026 el encuentro HEEPING-UP THE X-AGORA DAYS, centrado en el ecosistema RISC-V, el desarrollo de aceleradores hardware y el prototipado de soluciones de tipo System-on-Chip (SoC). La convocatoria combina ponencias técnicas y actividades prácticas para acercar las herramientas de diseño a investigadores y profesionales.

El encuentro está organizado por el Centro de Electrónica Industrial y Sistemas Multimodales (CEIMM) para la Cátedra de Investigación UPM-Indra, con apoyo institucional identificado en la convocatoria. Las actividades se celebran en la Escuela Técnica Superior de Ingenieros Industriales y conectan dos ámbitos: el diseño de circuitos integrados específicos y el uso de plataformas abiertas que permiten construir prototipos con mayor agilidad.

Qué aporta una arquitectura abierta como RISC-V

RISC-V define una arquitectura de conjunto de instrucciones que puede utilizarse como base de implementaciones de procesadores adaptadas a necesidades diferentes. Frente a arquitecturas cerradas, su carácter abierto facilita la investigación de extensiones, microarquitecturas y herramientas de desarrollo. No elimina las dificultades de diseñar un procesador fiable, pero permite explorar soluciones sin depender de una única implementación propietaria.

En un sistema embebido, el procesador es solo una parte del conjunto. Debe integrarse con memorias, buses, periféricos, interfaces de entrada y salida, mecanismos de control y, en determinadas aplicaciones, aceleradores especializados. La eficacia del diseño depende de la integración de todos estos elementos, del presupuesto energético y del comportamiento temporal de la aplicación.

FPGA, ASIC y aceleración de funciones especializadas

Las sesiones anunciadas por la UPM incluyen un taller práctico de prototipado digital con FPGA y una introducción al diseño ASIC utilizando herramientas de código abierto. Una FPGA permite implementar y modificar circuitos lógicos sobre un dispositivo reconfigurable, por lo que resulta útil para explorar arquitecturas y detectar errores antes de comprometerse con una fabricación de silicio. Un ASIC, por su parte, está concebido para una función específica y requiere un proceso de diseño, verificación y fabricación mucho más exigente.

Los aceleradores hardware buscan ejecutar ciertas tareas de forma más eficiente que una solución puramente software: procesamiento de señales, cálculos matriciales, inferencia de modelos o comunicaciones, entre otras. La ganancia real depende de cómo se mueven los datos, del consumo, de la latencia y de los costes de integración. Por eso es importante experimentar con prototipos y medidas, y no limitarse a comparar cifras teóricas de operaciones por segundo.

X-HEEP y el prototipado rápido de sistemas en chip

Una parte del programa se dedica a X-HEEP, una plataforma abierta para el prototipado rápido de soluciones SoC basadas en RISC-V. Este tipo de entornos permite organizar bloques reutilizables de procesador, memoria y periféricos, desarrollar configuraciones adaptadas a una aplicación y comprobar su funcionamiento con herramientas de diseño y simulación. La reutilización de módulos puede reducir trabajo repetitivo, aunque no sustituye a la verificación funcional ni a las pruebas de integración.

La relevancia de estas herramientas también está en la formación. Los estudiantes pueden recorrer de manera práctica distintas etapas de una cadena de diseño: describir funciones digitales, simularlas, sintetizar hardware, implementar un prototipo y contrastar sus resultados con los requisitos originales. Es una experiencia útil para comprender los compromisos entre superficie de silicio, potencia, rendimiento y coste.

El desarrollo de capacidades en diseño electrónico abierto es estratégico para universidades, centros tecnológicos y empresas que necesitan adaptar hardware a aplicaciones concretas. La colaboración entre formación universitaria, herramientas accesibles y casos de uso industriales puede contribuir a ampliar el conocimiento práctico disponible en microelectrónica y sistemas digitales.

Universidad Politécnica de Madrid

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